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钟控双稳态触发器

2025/11/13 23:18:30发布36次查看
具有时钟脉冲cp(clock pulse)输入端的双稳态触发器称为钟控双稳态触发器。钟控双稳态触发器输出状态的改变不仅取决于输入端信号,还决定于时钟脉冲信号。
按电路结构,钟控双稳态触发器可分为四门基本型、主从型和维持阻塞型等。
按逻辑功能,钟控双稳态触发器可分为rs触发器、t触发器、jk触发器和d触发器等。
按触发方式,钟控双稳态触发器可分为电平触发、主从触发和边沿触发等。
1.jk触发器
jk触发器是一种功能完善的触发器,右图所示是主从型jk触发器的逻辑符号。图中c处有“○”且加“∧”,可知触发器的触发方式采用时钟脉冲下降沿触发。j和k为输入控制端。
jk触发器的特性方程为
2.d触发器
d触发器的逻辑符号如下图所示,其真值表见下表。
d触发器的特性方程为
在触发方式上,d触发器采用的是边沿触发。在逻辑符号中,c处没有“○”有“∧”,可知d触发器是在时钟脉冲的上升沿接收输入信号并改变输出相应状态的。
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